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1.參與系統級架構或微架構設計，負責模塊的Function Spec和 architecture Spec編寫。

2.完成RTL代碼開發及代碼質量檢查，協助驗證問題定位，優化芯片時序、功耗與面積。

3.編寫SDC約束文件，完成預綜合及報告檢查，解決時間違例問題，確保芯片時序收斂。

4.協同后端團隊完成物理設計，提供時序約束與網表優化建議及STA報告檢查。

5.支持FPGA/palladium原型驗證及硅后調試，協助制定芯片規格書及芯片量產導入支持。

人員要求：

1.本科及以上學歷，微電子、電子工程、通信工程等相關專業，5年以上數字IC前端設計經驗。

2.精通RTL設計及驗證流程，邏輯綜合、形式驗證（Formality）、等EDA工具（如VCS、Spyglass、PrimeTime）。

3.熟悉以太網通信二三層協議，Traffic Management或者以太網高速接口設計，有以太網交換芯片或路由器芯片開發經驗者優先，有PON的設計也可以。

補充信息：

1.公司位置在北京理工大學，交通便利。

2.單位直簽合同，待遇優良，發展空間大。